NantilusDevelopment of a dynamic resource allocation controller for partially reconfigurable FPGAs with service guarantee approach
Les FPGAs dynamiquement reconfigurables permettent le changement d'accélérateurs matériels au temps de l'exécution. Cette technique permet notamment de réduire la taille des FPGAs dans les systèmes embarqués, réduisant les coûts de fabrication et la consommation d'énergie. Dès lors, d...
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| Auteurs principaux : | , , , , , , |
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| Collectivités auteurs : | , , |
| Format : | Thèse ou mémoire |
| Langue : | anglais |
| Titre complet : | Development of a dynamic resource allocation controller for partially reconfigurable FPGAs with service guarantee approach / Alexis Duhamel; sous la direction de Sébastien Pillement |
| Publié : |
2022 |
| Accès en ligne : |
Accès Nantes Université
|
| Note sur l'URL : | Accès au texte intégral |
| Note de thèse : | Thèse de doctorat : Sciences de l'ingénieur : Nantes Université : 2022 |
| Sujets : |
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| 230 | |a Données textuelles | ||
| 304 | |a Titre provenant de l'écran-titre | ||
| 314 | |a Ecole(s) Doctorale(s) : École doctorale Mathématiques et sciences et technologies de l'information et de la communication (Rennes) | ||
| 314 | |a Partenaire(s) de recherche : Institut d'Électronique et de Télécommunications (Rennes) (Laboratoire) | ||
| 314 | |a Autre(s) contribution(s) : François Verdier, Wiem Kouki, Eduardo De la Torre, Russel Tessier, Daniel Chillet (Membre(s) du jury) ; François Verdier (Rapporteur(s)) | ||
| 328 | 0 | |b Thèse de doctorat |c Sciences de l'ingénieur |e Nantes Université |d 2022 | |
| 330 | |a Les FPGAs dynamiquement reconfigurables permettent le changement d'accélérateurs matériels au temps de l'exécution. Cette technique permet notamment de réduire la taille des FPGAs dans les systèmes embarqués, réduisant les coûts de fabrication et la consommation d'énergie. Dès lors, de nouvelles problématiques de conception d'architectures et de leur gestion se posent, afin d'exploiter au mieux cette technique. La question de la garantie d'exécution des services se pose notamment en raison des besoins changeants des applications embarquées et de la complexité des algorithmes de gestion des ressources. L'objectif de ce travail est de proposer une méthodologie de gestion d'allocation des ressources matérielles afin de garantir un niveau minimum de service d'une application. Pour cela, un modèle de qualité est présenté, permettant de qualifier le niveau de service d'une application exécutée sur une architecture dynamiquement reconfigurable. Ce modèle de qualitéest utilisé afin de proposer deux méthodes permettant de gérer dynamiquement l'allocation des régions reconfigurables tout en maximisant la qualité du service rendu par le système. Enfin, un algorithme d'ordon nancement rapide et performant est introduit, permettant d'exploiter les caractéristiques des architectures dynamiquement reconfigurables. Les résultats obtenus sur un ensemble de benchmarks démontrent l'efficacité de l'ap proche proposée. | ||
| 330 | |a Embedded systems based on dynamically reconfigurable FPGAs allow hard ware accelerators to be swapped at runtime. This technique enables to reduce the size of FPGAs in embedded systems, reducing manufacturing costs and energy consumption. From then on, new challenges of architecture design and management arise, in order to make the most of this technique. Guarantee of service execution should be observed as embedded systems applications have changing compu tational needs, and the time complexity of resource allocation algorithms introduce latency overheads. The objective of this thesis is to propose a methodology for managing the allocation of hardware resources to guarantee a minimum level of service of an application. A quality model is introduced, allowing to qualify the service level of an application executed on a dynamically reconfigurable architecture. This quality model is used to propose two methodologies to dynamically manage the allocation of reconfigurable regions while maximizing the quality of service provided by the system. Finally, a fast and efficient scheduling algorithm is introduced to exploit the characteristics of our dynamically reconfigurable architecture. Results on a set of benchmarks demonstrate the effectiveness of the proposed approaches. | ||
| 337 | |a Configuration requise : un logiciel capable de lire un fichier au format : PDF | ||
| 541 | | | |a Développement d'un contrôleur dynamique de ressources allocation pour des FPGA partiellement reconfigurables |z fre | |
| 606 | |3 PPN034756957 |a Réseaux logiques programmables par l'utilisateur |2 rameau | ||
| 608 | |3 PPN027253139 |a Thèses et écrits académiques |2 rameau | ||
| 610 | 0 | |a Gestion d'allocation de ressources | |
| 610 | 0 | |a Garantie de service | |
| 610 | 0 | |a Accélération matérielle | |
| 610 | 0 | |a FPGA | |
| 610 | 0 | |a Reconfiguration dynamique partielle (RDP) | |
| 686 | |a 620 |2 TEF | ||
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